Русский dropdown-ico

Cypress CY7C1418AV18 инструкция обслуживания

1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31

Идти на страницу of

Похожие руководства по эксплуатации

Хорошее руководство по эксплуатации

Законодательство обязывает продавца передать покупателю, вместе с товаром, руководство по эксплуатации Cypress CY7C1418AV18. Отсутствие инструкции либо неправильная информация, переданная потребителю, составляют основание для рекламации в связи с несоответствием устройства с договором. В законодательстве допускается предоставлении руководства в другой, чем бумажная форме, что, в последнее время, часто используется, предоставляя графическую или электронную форму инструкции Cypress CY7C1418AV18 или обучающее видео для пользователей. Условием остается четкая и понятная форма.

Что такое руководство?

Слово происходит от латинского "instructio", тоесть привести в порядок. Следовательно в инструкции Cypress CY7C1418AV18 можно найти описание этапов поведения. Цель инструкции заключается в облегчении запуска, использования оборудования либо выполнения определенной деятельности. Инструкция является набором информации о предмете/услуге, подсказкой.

К сожалению немного пользователей находит время для чтения инструкций Cypress CY7C1418AV18, и хорошая инструкция позволяет не только узнать ряд дополнительных функций приобретенного устройства, но и позволяет избежать возникновения большинства поломок.

Из чего должно состоять идеальное руководство по эксплуатации?

Прежде всего в инструкции Cypress CY7C1418AV18 должна находится:
- информация относительно технических данных устройства Cypress CY7C1418AV18
- название производителя и год производства оборудования Cypress CY7C1418AV18
- правила обслуживания, настройки и ухода за оборудованием Cypress CY7C1418AV18
- знаки безопасности и сертификаты, подтверждающие соответствие стандартам

Почему мы не читаем инструкций?

Как правило из-за нехватки времени и уверенности в отдельных функциональностях приобретенных устройств. К сожалению само подсоединение и запуск Cypress CY7C1418AV18 это слишком мало. Инструкция заключает ряд отдельных указаний, касающихся функциональности, принципов безопасности, способов ухода (даже то, какие средства стоит использовать), возможных поломок Cypress CY7C1418AV18 и способов решения проблем, возникающих во время использования. И наконец то, в инструкции можно найти адресные данные сайта Cypress, в случае отсутствия эффективности предлагаемых решений. Сейчас очень большой популярностью пользуются инструкции в форме интересных анимаций или видео материалов, которое лучше, чем брошюра воспринимаются пользователем. Такой вид инструкции позволяет пользователю просмотреть весь фильм, не пропуская спецификацию и сложные технические описания Cypress CY7C1418AV18, как это часто бывает в случае бумажной версии.

Почему стоит читать инструкции?

Прежде всего здесь мы найдем ответы касательно конструкции, возможностей устройства Cypress CY7C1418AV18, использования отдельных аксессуаров и ряд информации, позволяющей вполне использовать все функции и упрощения.

После удачной покупки оборудования/устройства стоит посвятить несколько минут для ознакомления с каждой частью инструкции Cypress CY7C1418AV18. Сейчас их старательно готовят или переводят, чтобы они были не только понятными для пользователя, но и чтобы выполняли свою основную информационно-поддерживающую функцию.

Содержание руководства

  • Страница 1

    36-Mbit DDR-II SRAM 2-W ord Burst Architecture CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Cypress Semiconductor Corpora tion • 198 Champion Court • San Jose , CA 95134-1709 • 408-943-2600 Document Number: 38-05616 Rev . *F Revised January 29, 2009 Features ■ 36-Mbit density (4M x 8, 4M x 9, 2M x 18, 1M x 36) ■ 300 MHz clock[...]

  • Страница 2

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 2 of 31 Logic Block Diagram (CY7C1416A V18) Logic Block Diagram (CY7C1427A V18) Wri te Reg Wri te Reg CLK A (20:0) Gen. K K Control Logic Address Register Read Add. Decode Read Data Reg. R/W Output Logic Reg. Reg. Reg. 8 16 8 NWS [1:0] V REF Write Add.[...]

  • Страница 3

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 3 of 31 Logic Block Diagram (CY7C1418A V18) Logic Block Diagram (CY7C1420A V18) Wri te Reg Writ e Reg CLK A (20:0) Gen. K K Control Logic Address Register Read Add. Decode Read Data Reg. R/W Output Logic Reg. Reg. Reg. 18 36 18 BWS [1:0] V REF Write Ad[...]

  • Страница 4

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 4 of 31 Pin Configuration The pin configuration for CY7C1416A V18, CY7C1427 A V18, CY7C1418A V18, and CY7C1 420A V18 follow . [1] 165-Ball FBGA (15 x 17 x 1 .4 mm) Pinout CY7C1416A V18 (4M x 8) 123456789 10 11 A CQ NC/72M A R/W NWS 1 K NC/144M LD AA C [...]

  • Страница 5

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 5 of 31 CY7C1418A V18 (2M x 18) 123456789 10 11 A CQ NC/72M A R/W BWS 1 K NC/14 4M LD AA C Q B NC DQ9 NC A NC/288M K BWS 0 AN C N C D Q 8 C NC NC NC V SS AA 0A V SS NC DQ7 NC D NC NC DQ10 V SS V SS V SS V SS V SS NC NC NC E NC NC DQ1 1 V DDQ V SS V SS [...]

  • Страница 6

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 6 of 31 Pin Definitions Pin Name IO Pin Descripti on DQ [x:0] Input Output- Synchronous Dat a Input Output S ignals . Inputs are sampled on the rising edge of K and K clocks during valid write operations. These pins dri ve out t he requested data durin[...]

  • Страница 7

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 7 of 31 CQ Output Clock CQ Referenced with Respect to C . This is a free-running clock and is synchronized to the input clock for output data (C) of the DDR-II. In the single clock mode, CQ is generated wi th respect to K. The timing for the echo clock[...]

  • Страница 8

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 8 of 31 Functional Overview The CY7C1416A V18, CY7C142 7A V18, CY7C1418A V18, and CY7C1420A V18 are synchronous pipel ined Burst SRAMs equipped with a DDR interface. Accesses are initiated on the ri sing edge of the positive input clock (K). All synchr[...]

  • Страница 9

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 9 of 31 Depth Exp ansion Depth expansion requires replicating the LD control signal for each bank. All other co ntrol signals can be common between banks as appropriate. Programmable Impedan ce An external resistor , RQ, must be connected between the Z[...]

  • Страница 10

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 10 of 31 T ruth T able The truth table for the CY7C1416A V18, CY7C1427A V18, CY7C1418 A V18, and CY7C1420A V18 follows. [2, 3, 4, 5, 6, 7] Operation K LD R/W DQ DQ Write Cycle: Load address; wait one cycle; input write data on consecutive K and K risin[...]

  • Страница 11

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 1 1 of 31 Write Cycle Descriptions The write cycle description tabl e for CY7C1427A V18 follows. [2, 8] BWS 0 K K Comments L L–H – During the Data portion of a write sequence, the single byte (D [8:0] ) is written int o the de vi ce . L – L–H D[...]

  • Страница 12

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 12 of 31 IEEE 1 149.1 Serial Boundary Scan (JT AG) These SRAMs incorporate a serial boundary scan T est Access Port (T AP) in the FBGA p ackage. This part is fully comp liant with IEEE S tandard #1 149.1 -1900. The T AP operates using JEDEC standard 1.[...]

  • Страница 13

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 13 of 31 IDCODE The IDCODE instruction loads a vendor-specific, 32-bi t code into the instruction re gister . It a lso places the instruction register between the TDI and TDO pins and shifts the IDCODE out of the device when the T AP controller enters [...]

  • Страница 14

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 14 of 31 T AP Controller St ate Diag ram The state diagram for the T AP controller follows. [9] TEST -LOGIC RESET TEST -LOGIC / IDLE SELECT DR-SCAN CAPTURE-DR SHIFT -DR EXIT1-DR P AUSE-DR EXIT2-DR UPDA TE-DR 1 0 1 1 0 1 0 1 0 0 0 1 1 1 0 1 0 1 0 0 0 1 [...]

  • Страница 15

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 15 of 31 T AP Controller Block Diagram T AP Electrical Characteristics Over the Operating Range [10, 1 1, 12] Parameter Description T est Conditions Min Max Unit V OH1 Output HIGH V oltage I OH = − 2.0 mA 1.4 V V OH2 Output HIGH V oltage I OH = − 1[...]

  • Страница 16

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 16 of 31 T AP AC Switching Characteristics Over the Operating Range [13, 14] Parameter Description Min Max Unit t TCYC TCK Clock Cycle Time 50 ns t TF TCK Clock Frequency 20 MHz t TH TCK Clock HIGH 20 ns t TL TCK Clock LOW 20 ns Setup Times t TMSS TMS [...]

  • Страница 17

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 17 of 31 Identification R egi ster Definitions Instruction Field Va l u e De scription CY7C1416A V18 CY7C1427A V1 8 CY7C1418A V18 CY7C1420A V18 Revision Numb er (31:29) 000 000 000 000 V ersion numbe r . Cypress Device ID (28:12) 1 1 0101000100001 1 1 [...]

  • Страница 18

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 18 of 31 Boundary Scan Order Bit # Bump ID Bit # Bump ID Bit # Bump ID Bit # Bum p ID 0 6R 28 10G 56 6A 84 1J 1 6 P2 9 9 G 5 7 5 B8 5 2 J 2 6N 30 1 1F 58 5A 86 3K 3 7P 31 1 1G 59 4A 87 3J 4 7 N3 2 9 F 6 0 5 C8 8 2 K 5 7R 33 10F 61 4B 89 1K 6 8R 34 1 1E[...]

  • Страница 19

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 19 of 31 Power Up Sequence in DDR-II SRAM DDR-II SRAMs must be power ed up and initialized in a predefined manner to prevent unde fined operations. Power Up Sequence ■ Apply power and drive DO FF either HIGH or LOW (All other inputs can be HIGH or LO[...]

  • Страница 20

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 20 of 31 Maximum Ratings Exceeding maximum ratin gs may impair the useful life o f the device. These user guidelines are not teste d. S torage T emperature ................ ................ . –65°C to +150°C Ambient T empe rat ure with Power App li[...]

  • Страница 21

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 21 of 31 I DD [19] V DD Operating Supply V DD = Max, I OUT = 0 mA, f = f MAX = 1/t CYC 200MHz (x8) 600 mA (x9) 600 (x18) 620 (x36) 675 167MHz (x8) 500 mA (x9) 500 (x18) 525 (x36) 570 I SB1 Automatic Power down Current Max V DD , Both Ports Deselected, [...]

  • Страница 22

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 22 of 31 Cap acit ance T ested initially and after any design or process change that may affect these parameters. Parameter Description T est Conditions Max Unit C IN Input Capacitance T A = 25 ° C, f = 1 MHz, V DD = 1.8V , V DDQ = 1.5V 5 pF C CLK Clo[...]

  • Страница 23

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 23 of 31 Switching Characteristics Over the Operating Range [20, 21] Cypress Parame- ter Consor- tium Pa- rameter Description 300 MHz 278 MHz 250 MHz 200 MHz 167 MHz Unit Min Max Min Max Min Max Min Max Min Max t POWER V DD (T ypical) to the First Acce[...]

  • Страница 24

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 24 of 31 Output T imes t CO t CHQV C/C Clock Rise (or K/K in single clock mode) to Data V a lid – 0.45 – 0.45 – 0.45 – 0.45 – 0.50 ns t DOH t CHQX Data Output Hold af ter Output C/C Clock Rise (Active to Active) –0.4 5 – –0.4 5 –– 0[...]

  • Страница 25

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 25 of 31 Switching W aveforms Figure 5. Read/Write/Deselect Sequence [2 6, 27, 28 ] READ READ READ NOP NOP WRITE WRITE NOP 1 23 4 56 7 8 9 1 0 Q40 t KHCH t CO t t HC t t HA t SD t HD t KHCH t SD t HD DON’ T CARE UNDEFINED t CLZ t DOH t CHZ SC t KH t [...]

  • Страница 26

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 26 of 31 Ordering Information Not all of the speed, package and temperature ranges are ava ilable. Please contact your local sales representative or visit www .cypress.com for actual products offered. Spee d (MHz) Ordering Code Package Diagram Package [...]

  • Страница 27

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 27 of 31 250 CY7C1416A V18-250BZC 51-85195 1 65-Ball Fine Pitch Ball Grid Array (15 x 17 x 1.4 mm) Commercial CY7C1427A V18-250BZC CY7C1418A V18-250BZC CY7C1420A V18-250BZC CY7C1416A V18-250BZXC 5 1-85195 165-Ball Fine Pi tch Ball Grid Array (15 x 17 x[...]

  • Страница 28

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 28 of 31 167 CY7C1416A V18-167BZC 51-85195 1 65-Ball Fine Pitch Ball Grid Array (15 x 17 x 1.4 mm) Commercial CY7C1427A V18-167BZC CY7C1418A V18-167BZC CY7C1420A V18-167BZC CY7C1416A V18-167BZXC 5 1-85195 165-Ball Fine Pi tch Ball Grid Array (15 x 17 x[...]

  • Страница 29

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 29 of 31 Package Diagram Figure 6. 165-ball FBGA (15 x 17 x 1.4 mm), 51-8 5195 !  0).#/2.%2 ¼ ¼   ?[...]

  • Страница 30

    CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, CY7C1420A V18 Document Number: 38-05616 Rev . *F Page 30 of 31 Document History Page Document Title: CY7C1416A V18, CY7C1427A V18, CY7C1418A V18, CY7C1420A V18, 36-Mbit DDR-II SRAM 2-Word Burst Architecture Document Number: 38-05616 Rev . ECN Oirg. Of Change Submission Date Desc ription Of Change ** 24733[...]

  • Страница 31

    Document Number: 38-05616 Rev . *F Revised January 29, 2009 Page 31 of 31 DDR RAMs and QDR RAMs comprise a new fam ily of products develope d by Cypress, Hitachi, IDT , Micron, NEC, a nd Samsung. All p rodu ct and company names mentione d in this document are the trademarks of the ir respective holders. CY7C1416A V18, CY7C1427A V18 CY7C1418A V18, C[...]